Riverlane, 오류 수정 스택을 향한 단계에서 디코더 칩 공개 – Inside Quantum Technology

양자 컴퓨팅 분야가 충실도와 오류율 향상에 지속적으로 초점을 맞추면서 Riverlane은 오류 예측 및 수정을 위한 전용 ASIC 데모 디코더 칩을 발표하고 디코더 IP와 논문을 발표했습니다. 자원 효율적인 오류 수정 양자 컴퓨터의 경우.

이러한 움직임은 Riverlane과 다른 사람들이 모든 양자 컴퓨터가 유용한 규모를 달성해야 한다고 주장한 양자 오류 수정 스택을 구축하려는 회사의 지속적인 노력에서 중요한 진전을 나타냅니다. 

Riverlane의 CEO이자 설립자인 Steve Brierley는 “우리는 수백 개의 양자 작업에서 XNUMX조 개의 양자 작업까지 실패 없이 확장해야 하는 기술의 결정적인 과제를 해결하기 시작하는 새로운 양자 컴퓨팅 시대로 진입하고 있습니다. 

Riverlane은 올해 0분기에 라이브 하드웨어에서 계획된 Decode ASIC 제품군 중 첫 번째인 DD1A ASIC을 시연할 계획이며, DDXNUMX 디코더 IP 공개를 통해 빠른 프로토타이핑 및 통합이 가능해졌습니다. 양자 컴퓨터 제조업체가 자체 하드웨어에 통합할 수 있도록 FPGA에 배포됩니다.

"우리는 FPGA와 ASIC 모두에서 디코더를 구현하며, 후자는 궁극적으로 비용 효율적이고 확장 가능한 솔루션에 필요합니다"라고 회사의 연구 보고서에 명시되어 있습니다. 

새로운 솔루션은 초전도, 포획된 이온, 중성 원자 양자 하드웨어에 통합될 수 있다고 Riverlane은 말했습니다.

Brierley는 “우리는 현재 실제 하드웨어에 양자 알고리즘을 구현하고 있습니다. 결정적으로 Riverlane은 실제 문제를 해결하기 위해 실제 디코더를 만드는 데 필요한 모든 측정 항목을 처리할 수 있는 균형을 찾았으며, 이를 통해 우리 디코더를 가장 강력한 디코더로 만들었습니다.”

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Dan O'Shea는 25년 넘게 반도체, 센서, 소매 시스템, 디지털 결제 및 양자 컴퓨팅/기술을 포함한 통신 및 관련 주제를 다루었습니다.

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• 출처: https://www.insidequantumtechnology.com/news-archive/riverlane-unveils-decoder-chip-in-step-toward-error-correction-stack/